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    1 一種芯片IO干擾信號(hào)的產(chǎn)生方法及抗干擾能力的驗(yàn)證方法 發(fā)明專利 CN202210326693.8 CN114660970A 2022-06-24
    2 基于差分結(jié)構(gòu)的SARADC失調(diào)誤差校正方法及電路 發(fā)明專利 CN202210325341.0 CN114614821A 2022-06-10

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